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Konzeption eines Vierquadrantennetzteiles in Klasse-D Topologie

Moser, Sascha Oliver (2016) Konzeption eines Vierquadrantennetzteiles in Klasse-D Topologie. DLR-Interner Bericht. RM-OP-2016-70. Masterarbeit. Technische Universität München. 87 S.

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Kurzfassung

Inhalt dieser Masterarbeit ist der theoretische Entwurf eines Vierquadrantennetzteiles für leitungsgebundene Tests der elektromagnetischen Verträglichkeit angelehnt an MIL-STD-461E (CS101). Das primäre Ziel dieser Arbeit ist es, ein tragbares System basierend auf einem verlustarmen Schaltwandler mit einem einstellbaren Ausgangsspannung von -2 Volt bis 56 Volt bei einem Ausgangsstrom von -15 Ampere bis 35 Ampere zu entwickeln. Daraus ergibt sich eine maximale Ausgangsleistung von 1960 Watt. Zudem ist eine weitere Anforderung, dass die genannten Spezifikationen in einem Frequenzbereich von 20 Hz bis einschließlich 100 kHz eingehalten werden müssen. Hierfür werden verschiedene Klasse-D Schalttopologien verglichen und ein Multiphasen-Verstärker mit Phasenstromregelung bestimmt. Alle für den Schaltwandler benötigten Bauelemente werden speziell für diese Anwendung ausgelegt und ausgewählt. Für diese Topologie wird eine Peak-Current Regelung modelliert, anschließend in MATLAB und LTSPICE IV simuliert und gegeneinander verglichen. Ein besonderer Fokus liegt auf der Auslegung des Schaltwandlers zum Erhalt eines hohen Wirkungsgrades. Basierend auf den berechneten Systemverlusten resultiert ein theoretischer maximaler Wirkungsgrad von 98,14 %. Dieser wird durch den Einsatz von Gallium-Nitrid-Transistoren erreicht, welche in dieser Arbeit mit Silizium-Transistoren verglichen werden. Des Weiteren werden zur Kommunikation und Fernsteuerung dieses Systems diverse digitale Schnittstellen benötigt. Auf Basis dieser Arbeit soll es zukünftig möglich sein, ein kompaktes System zur vollautomatischen Messung nach MIL-STD-461E (CS101) zu realisieren.

elib-URL des Eintrags:https://elib.dlr.de/104024/
Dokumentart:Berichtsreihe (DLR-Interner Bericht, Masterarbeit)
Titel:Konzeption eines Vierquadrantennetzteiles in Klasse-D Topologie
Autoren:
AutorenInstitution oder E-Mail-AdresseAutoren-ORCID-iDORCID Put Code
Moser, Sascha OliverSascha.Moser (at) dlr.deNICHT SPEZIFIZIERTNICHT SPEZIFIZIERT
Datum:14 April 2016
Referierte Publikation:Nein
Open Access:Ja
Seitenanzahl:87
Status:veröffentlicht
Stichwörter:Schaltnetzteil, Klasse-D, Transistoren, GaN, FET, Multiphasen, Tiefsetzsteller, Stromregelung
Institution:Technische Universität München
Abteilung:Lehrstuhl für Elektrische Antriebssysteme und Leistungselektronik
HGF - Forschungsbereich:Luftfahrt, Raumfahrt und Verkehr
HGF - Programm:Raumfahrt
HGF - Programmthema:Technik für Raumfahrtsysteme
DLR - Schwerpunkt:Raumfahrt
DLR - Forschungsgebiet:R SY - Technik für Raumfahrtsysteme
DLR - Teilgebiet (Projekt, Vorhaben):R - Terrestrische Assistenz-Robotik (alt)
Standort: Oberpfaffenhofen
Institute & Einrichtungen:Institut für Robotik und Mechatronik (ab 2013) > Mechatronische Komponenten und Systeme
Hinterlegt von: Moser, Sascha
Hinterlegt am:07 Jun 2016 14:11
Letzte Änderung:31 Jul 2019 20:01

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